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PDF Z-80A Data sheet ( Hoja de datos )
| Número de pieza | Z-80A | |
| Descripción | Z80A | |
| Fabricantes | ETC | |
| Logotipo |  |
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Z80 Family
CPU Peripherals
User Manual
UM008101-0601
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ZiLOG Worldwide Headquarters • 910 E. Hamilton Avenue • Campbell, CA 95008
Telephone: 408.558.8500 • Fax: 408.558.8300 • www.ZiLOG.com
1 page  
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Z80 CPU Peripherals
User Manual
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v
Direct Memory Access (continued)
Write Register 3 Group . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .97
Write Register 4 Group . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .99
Write Register 5 Group . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .102
Write Register 6 Group . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .104
Read Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .113
Review of Programming Sequences . . . . . . . . . . . . . . . . . . . . . .117
Applications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .128
Z80 DMA and CPU . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .128
Z80 DMA and Z80 SIO Example . . . . . . . . . . . . . . . . . . . . . . . .138
Using The Z80 DMA With Other Processors . . . . . . . . . . . . . . .142
Performance Limitations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .148
Bus Contention . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .148
Control Overhead . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .149
Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .150
The CPU As Bus Master . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .150
The DMA As Bus Master . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .152
Register Bit Functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .170
Write Register Bit Functions . . . . . . . . . . . . . . . . . . . . . . . . . . .170
Read Register Bit Functions . . . . . . . . . . . . . . . . . . . . . . . . . . . .174
Parallel Input/Output
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .175
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .175
PIO Architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .176
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .176
Pin Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .180
Programming the PIO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .187
Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .187
www.DataSheLSeeolate4dciUtning.gcToAhmen IOnpteerrrautpintgVMecotodre
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.188
.189
Setting The Interrupt Control Word . . . . . . . . . . . . . . . . . . . . . .191
Table of Contents
UM008101-0601
5 Page 
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Z80 CPU Peripherals
User Manual
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xi
Direct Memory Access (continued)
Figure 50. CE/WAIT Multiplexer . . . . . . . . . . . . . . . . . . . . . . . . . . .133
Figure 51. Simultaneous Transfer Multiplexer . . . . . . . . . . . . . . . . .133
Figure 52. Simultaneous Transfer . . . . . . . . . . . . . . . . . . . . . . . . . . .134
Figure 53. Delaying the Leading Edge of MWR . . . . . . . . . . . . . . . .135
Figure 54. Data Bus Buffer Control Example . . . . . . . . . . . . . . . . . .138
Figure 55. DMA-SIO Environment . . . . . . . . . . . . . . . . . . . . . . . . . .142
Figure 56. Connecting DMA to Demultiplexed Address/Data Buses 145
Figure 57. Z8000/Z80 Peripheral Interface . . . . . . . . . . . . . . . . . . . .147
Figure 58. DMA Bus-Master Gate (Byte or Burst Modes Only) . . . .149
Figure 59. CPU-to-DMA Write Cycle Requirements . . . . . . . . . . . .151
Figure 60. CPU-to-DMA Read Cycle Requirements . . . . . . . . . . . . .152
Figure 61. Sequential Memory-to-I/O Transfer, Standard Timing
(Searching is Optional) . . . . . . . . . . . . . . . . . . . . . . . . . . .154
Figure 62. Sequential I/O-to-Memory Transfer, Standard Timing
(Searching is Optional) . . . . . . . . . . . . . . . . . . . . . . . . . . .155
Figure 63. Simultaneous Memory-to-I/O Transfer (Burst and Continuous
Mode) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .156
Figure 64. Simultaneous Memory-to-I/O Transfer (Byte Mode) . . . .157
Figure 65. Bus Request and Acceptance Timing . . . . . . . . . . . . . . . .159
Figure 66. Bus Release in Byte Mode . . . . . . . . . . . . . . . . . . . . . . . .160
Figure 67. Bus Release on End-of-Block (Burst and
Continuous Modes) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .160
Figure 68. Bus Release on Match (Burst and Continuous Modes) . .161
Figure 69. Bus Release on Not Ready (Burst Mode) . . . . . . . . . . . . .162
Figure 70. RDY Line in Byte Mode . . . . . . . . . . . . . . . . . . . . . . . . . .163
Figure 71. RDY Line in Burst Mode . . . . . . . . . . . . . . . . . . . . . . . . .164
www.DataSheFiegtu4reU7.2c.omRDY Line in Continuous Mode . . . . . . . . . . . . . . . . . . . .165
Figure 73. Variable-Cycle and Edge Timing . . . . . . . . . . . . . . . . . . .166
List of Figures
UM008101-0601
11 Page | ||
| Páginas | Total 30 Páginas | |
| PDF Descargar | [ Datasheet Z-80A.PDF ] | |
Hoja de datos destacado
| Número de pieza | Descripción | Fabricantes |
| Z-80A | Z80A | ETC |
| Número de pieza | Descripción | Fabricantes |
| SLA6805M | High Voltage 3 phase Motor Driver IC. |
 Sanken |
| SDC1742 | 12- and 14-Bit Hybrid Synchro / Resolver-to-Digital Converters. |
 Analog Devices |
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